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VHDL各种D触发器程序VHDL各种D触发器程序VHDL各种D触发器程序第一题：普通触发器LIBRARYIEEE；USEIEEE.STD_LOGIC_1164.ALL;ENTITYDchuISPORT(CLK,D:INSTD_LOGIC；Q:OUTSTD_LOGIC);END;ARCHITECTUREFFQOFDchuISSIGNALQ1:STD_LOGIC;BEGINPROCESS（CLK,Q1）BEGINIFCLK’EVENTANDCLK='1’THENQ1<=D;ENDIF;ENDPROCESS;Q<=Q1;ENDFFQ;第二题:异步清零触发器LIBRARYIEEE；USEIEEE。STD_LOGIC_1164。ALL；ENTITYDchuISPORT（CLK,D:INSTD_LOGIC；Q:OUTSTD_LOGIC；ACLK:INSTD_LOGIC);END；ARCHITECTUREFFQOFDchuISSIGNALQ1：STD_LOGIC;BEGINPROCESS(ACLK,CLK，Q1）BEGINIFACLK='1’THENQ1〈=’0’；ELSIFCLK’EVENTANDCLK=’1’THENQ1〈=D;ENDIF；ENDPROCESS；Q〈=Q1;ENDFFQ;第三题：同步清零触发器LIBRARYIEEE;USEIEEE.STD_LOGIC_1164。ALL;ENTITYDchuISPORT（CLK,D：INSTD_LOGIC；Q:OUTSTD_LOGIC；SCLK:INSTD_LOGIC);END;ARCHITECTUREFFQOFDchuISSIGNALQ1：STD_LOGIC；BEGINPROCESS(SCLK，CLK，Q1)BEGINIFCLK’EVENTANDCLK='1'THENIFSCLK=’1'THENQ1〈='0';ELSEQ1〈=D；ENDIF;ENDIF;ENDPROCESS；Q〈=Q1;ENDFFQ;第四题:异步置位apreLIBRARYIEEE;USEIEEE.STD_LOGIC_1164.ALL;ENTITYDchuISPORT（CLK：INSTD_LOGIC；D：INSTD_LOGIC；Q:OUTSTD_LOGIC；APRE:INSTD_LOGIC）;END；ARCHITECTUREFFQOFDchuISSIGNALQ1:STD_LOGIC；BEGINPROCESS（APRE,CLK，Q1）BEGINIFAPRE=’1'THENQ1〈=’1';ELSIFCLK’EVENTANDCLK='1'THENQ1<=D;ENDIF;ENDPROCESS；Q〈=Q1;ENDFFQ；第五题：同步置位spreLIBRARYIEEE；USEIEEE.STD_LOGIC_1164。ALL；ENTITYDchuISPORT（CLK：INSTD_LOGIC；D：INSTD_LOGIC；Q：OUTSTD_LOGIC；SPRE:INSTD_LOGIC）；END；ARCHITECTUREFFQOFDchuISSIGNALQ1:STD_LOGIC；BEGINPROCESS(SPRE，CLK,Q1)BEGINIFCLK'EVENTANDCLK='1’THENIFSPRE=’1’THENQ1〈='1’；ELSEQ1<=D;ENDIF；ENDIF;ENDPROCESS；Q<=Q1;ENDFFQ；第六题：异步清零，异步置位LIBRARYIEEE；USEIEEE.STD_LOGIC_1164。ALL;ENTITYDchuISPORT(CLK：INSTD_LOGIC;ACLR：INSTD_LOGIC；APRE：INSTD_LOGIC；D：INSTD_LOGIC；Q:OUTSTD_LOGIC）;END;ARCHITECTUREFFQOFDchuISSIGNALQ1:STD_LOGIC;BEGINPROCESS（APRE，ACLR，CLK，Q1）BEGINIFACLR=’1’THENQ1<='0’;ELSIFAPRE=’1'THENQ1<=’1’;ELSIFCLK'EVENTANDCLK='1'THENQ1<=D；ENDIF；ENDPROCESS;Q〈=Q1;ENDFFQ;第七题：同步使能LIBRARYIEEE；USEIEEE。STD_LOGIC_1164.ALL；ENTITYDchuISPORT(CLK：INSTD_LOGIC;D：INSTD_LOGIC；Q:OUTSTD_LOGIC；EN:INSTD_LOGIC）；END;ARCHITECTUREFFQOFDchuISSIGNALQ1:STD_LOGIC；BEGINPROCESS（EN，CLK,Q1)BEGINIFCLK’EVENTANDCLK=’1’THENIFEN=’1’
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