08级计算机组成原理本科期末试题A带答案(史岚).doc

总分一二三四五六七八学院班级学号姓名
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东北大学考试试卷（A卷）
2010—2011学年第一学期
课程名称：计算机组成原理（，八个大题）
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在浮点加减运算中，当运算结果的尾数绝对值大于1时，需要对结果进行A，其操作是B。
A：右规（向右规格化）
B：尾数右移一位，阶加1
2．按字节编址的计算机主存储器，每次读/写A个二进制位，16位二进制地址码所能访问的存储容量是BKB。
A：8
B：64
3．某计算机字长为32位，存储容量2MW，若按半字编址，它的寻址范围是A。
A：4M（0~4M，0~4M-1）
4．程序控制类指令的功能是A。
A：改编程序执行顺序
5．计算机中时序信号最基本的体制是A。
A：电位-脉冲制
6．微指令的编码表示法中分段编码的原则是可以把A的微命令编在同一字段内，而B的微命令应该编在不同的字段内。
A：相斥（互斥）
B：相容
7．DMA传送可采用以下三种方式：A、B和C交替访内。
A：CPU停止访问内存
B：周期挪用（周期窃取）（A，B无顺序）
C：CPU和DMA
8．统一编址方式是将A和B统一进行编址。
A：内存单元
B：I/O端口（设备接口中寄存器）（A，B无顺序）
9．CPU内部的中断允许触发器用来表示A。
A：CPU开放或禁止响应可屏蔽的中断请求

10．组合逻辑控制的计算机中采用的三级时序信号是：主状态周期（CPU周期）电位、节拍电位和A。
A：（节拍）脉冲
11．二进制浮点数X=－0.100000111B×2－1000B写成IEEE754标准的单精度（32位）浮点数并压缩成十六进制应为A。
A：BB038000H
12．DRAM存储器的刷新一般有A、B和C三种方式。
A：集中式
B：分散式
C：异步式（无顺序）
13．中断响应周期需要保护的两个关键硬件状态是A和B。
A：程序断点（PC内容）
B：程序状态字（PSW）（无顺序）
14．单重中断和多重中断的主要区别在于A。
A：后者允许嵌套
15．某计算机的Cache-主存系统中，Cache的存储周期为4.5ns，主存的存储周期为20ns。已知在一段给定时间内，CPU共计访问该Cache-主存系统4500次，其中340次访问主存。则该Cache的命中率为A。
A：92.44%
16．设相对寻址的转移指令占两个字节，第一个字节是操作码，第二个字节是补码表示的相对位移量；若CPU每当从存储器取出一个字节即自动完成（PC）+1，设当前PC的内容为2002H，要求转移到200AH地址，则该转移指令第二个字节的内容应为AH。
A：06

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三、（10分）某计算机主存具有24bit地址和16bit的字长。问：
（1）该存储器能存储多少字节的信息？
（2）如果用4M×4bit的SRAM芯片组成该存储器，需要多少片？
（3）用文字简要说明这些SRAM芯片如何组织并指出需要多少位地址做芯片选择？
解答：
（1）32MB（32M个字节）
（2）需16片
（3）每4片4M×4bit的SRAM芯片并联成一个4M×16bit的单元，再用4个这样的单元（共16片）串联，四个单元的选择及芯片选择使用24位地址中的高2位：A23和A22（A21~A0这22位为片内寻址用）。
二、（10分）若要用74181和74182器件设计二级先行进位的16位ALU，问74181和74182各需要用几片？请使用74181和74182的逻辑符号画出该16位ALU的逻辑框图（图中主要表示出进位之间的连接关系即可）。
解答：需要74181共4片，74182共1片。
逻辑框图如下：

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五、（13分）假定某计算机主存与数据Cache之间采用直接映射方式，块大小为16B。已知该Cache的数据区容量为64KB，主存的地址为32位，按字节编址。为了正确访问，Cache的每个块设了一个“valid”（有效）位；而为了采用写回策略，Cache的每个块还要设一个“dirty”（脏）位。问：
（1）主存地址如何划分（分几个字段、各个字段的名称和位数）？
（2）该数据Cache的总容量是多少KB？要求列出计算过程。
解答：
Cache中有行数（块数）64KB÷